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2025/1/15 9:42:16
FPGA verilog设计的MODBUS CRC算法
已经测试通过。 timescale 1ns / 1ps // // Company: // Engineer: // // Create Date: 20:14:12 05/18/2023 // Design Name: // Module Name: Modbus_CRC // Project Name: // Target Devices: // Tool versions: // Description: // // Dependencies: // // Revision: // Re…
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2025/1/22 23:41:35
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先看一个题目: 给40亿个不重复的无符号整数,没排过序。给一个无符号整数,如何快速判断一个树是否在这40亿个数中? 这里可能…
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2025/1/22 23:41:58
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2025/1/22 6:31:33
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2025/1/17 0:03:33
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2025/1/20 6:29:54